1樓：中國死狗
用途不一樣
vhdl等硬體描述語言主要用於cpld、fpga的大規模可程式設計邏輯器件
而c語言等高階程式語言主要用於計算機等方面
計算機硬體描述語言(vhdl)與程式語言（c語言）的區別及關係，
2樓：匿名使用者
硬體描述需要誇大其詞。軟體程式設計需要短小精幹 但兩個又不可能分開，最後聯合在一起騙買的人！
請問硬體描述語言與軟體描述語言有什麼區別？不都是在計算機上程式設計 然後傳到一個板子上 板子工作嗎？
3樓：浪子漂浮
當然有區別啊，硬體描述語言程式設計是對可程式設計器件內部邏輯資源 自己組合，相當於自己去設計內部電路。而c語言c+之類的一般應用的晶片內部已經固化，你改變不了，你編寫程式是對內部暫存器操作
軟體程式語言和硬體描述語言的差別？？？
4樓：智仗仙人
verilog hdl 的程式燒到晶片裡會影響晶片裡的電路結構吧~ c編譯成機器碼以後一般都是在通用計算機上跑~這個問題很大有點不知道從何說起，老衲盡力了
verilog語言與c語言的區別？
5樓：啦啦啦額
verilog和c之間的區別
1、定義：
verilog是用於類比電子系統的硬體描述語言（hdl），而c是允許結構化程式設計的通用程式設計語
言。因此，這是verilog和c之間的主要區別。
2、副檔名：
副檔名是verilog和c之間的另一個區別.verilog檔案具有.v或.vh副檔名，而c檔案具
有.c副檔名。
3、用法
verilog有助於設計和描述數字系統，而c有助於構建作業系統，資料庫，編譯器，直譯器，網
絡驅動程式等。
verilog是一種硬體描述語言（hdl），有助於描述網路交換機，微處理器，觸發器等數字系
統。因此，可以使用該語言描述數字系統的硬體。
c是一種支援結構化程式設計的高階通用程式語言。c語言的開發人員是dennis ritchie。它是許多
程式語言的基礎，如python，java等。程式設計師可以很容易地理解c程式，但計算機不理解它
們。因此，編譯器將c源**轉換為等效的機器**。計算機瞭解此機器**，並執行程式中
定義的任務。c程式的執行速度比基於直譯器的程式語言（如php，python等）更快。
6樓：匿名使用者
verilog是硬體描述語言
7樓：
verilog語言是設計硬體電路的，硬體電路一個特點就是並行，而c語言是序列執行的，這就是最大的區別。verilog語言最後都要轉換為實際的電路的；而c語言最終轉化為二進位制碼。
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1 現在 復 c語言建議使用microsoft visual studio 程式設計 制軟體比較好，應該該軟體與電腦windows 7,8,10等系統相容性比較好。2 microsoft visual studio 簡稱vs 是美國微軟公司的開發工具包系列產品。vs是一個基本 完整的開發工具集，它包...
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這個不是一兩句話解釋的清的。但告訴你的是，能學精一門足矣 計算機等級證書分幾級？哪個級別最高？計算機等級整數分四級，四級的最高。一級 考核計算機基礎知識及計算機基本內 操作能力，容包括office辦公軟體 圖形影象軟體。二級 程式設計 辦公軟體高階應用級。分為 軟體測試技術 資訊安考核微型計算機基礎...
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二者是不一樣的來 我就是自 漢語言文學師範類的 漢語言文學於新聞傳播同屬文學院 但二者是不同專業 新聞傳播是非師類的 新聞傳播以後可以去電視臺做新聞記者或主持，大二後分流，分為廣告類與新聞類 漢語言文學可以以後當老師，編輯，留校，文祕，考公務員，去企事業單位或黨政機關 漢語言文學 新聞傳播方向 與一...