1樓：匿名使用者
只要不讓資料溢位就沒問題
但是現在數字訊號處理都是補碼運算的
verilog如何實現兩數相減
2樓：不會水的小兵
1、像你這樣也是可以的，但只能以大減小。
2、你的輸入輸出都為無符號數，結果是無所謂正負之分的，也無溢位。要想結果可正可負，你可以將暫存器都設定成有符號數的，但這樣一來就有溢位的問題了，但只要你在進行運算時注意結果不要超出範圍就行了。
3樓：匿名使用者
不可以，結果可能會溢位，用9位暫存器儲存吧
請教verilog裡變數宣告時和有什麼區別
4樓：黛沫沫謊
1、模組宣告的擴充套件
（1） verilog‐2001允許將埠宣告和資料型別宣告放在同一條語句中，例子如下：
向左轉|向右轉
（2）verilog‐2001中增加了ansic風格的輸入輸出埠宣告，可以用於module，task和function。例子如下：
向左轉|向右轉
（3）對於含有parameter的module，例子如下：
向左轉|向右轉
2、帶有初始化的暫存器型別變數宣告
verilog‐2001中允許在宣告變數的同時對其進行初始化賦值，他是在initial語句中的0時刻開始執行。例子如下：
3、敏感表的改進
（1）逗號分開敏感列表
在敏感表中的變數可以用逗號「，」分開，當然，當然or也是可以的。例子如下：
always@(posedge clk,negedge rst)也是可以的。
（2）組合邏輯的電平敏感@* //@(*) is also ok
「*」代表了邏輯塊中每個被賦值的變數，例子如下：
4、有符號算數運算的擴充套件
（1）net型和reg型可以宣告為帶符號的變數
（2）函式的返回值可以是有符號數
（3）literal integer numbers可以定義為有符號的
（4）增加算數右移左移（>>>,<<<）
操作符「>>>」和「<<<」。對於有符號數，執行算術移位操作時，將符號位填補移出的位。例子如下：
（5）增加系統函式$signed，$unsigned
用於在無符號和有符號數之間的轉換
5、可變向量域的選擇
[+」:width]從起始位開始遞增，位寬為width
[‐」:width]從起始位開始遞減，位寬為width
其中，起始位可以是變數，但位寬必須是整數。因此可以用可變域選擇，用迴圈語句選取一個很長的向量所有位。
6、多維陣列的建立
verilog‐1995中只允許對reg，integer和time建立一維的陣列，常用於ram,rom的建模。verilog‐2001中可以對net和variable建立多維陣列。
7、多維陣列的賦值
verilog‐1995不允許直接訪問矩陣字的某一位或某幾位，必須將整個矩陣字複製到另一個暫存變數中，從暫存中訪問。
verilog‐2001可以直接訪問矩陣的某一維或某幾位。
8、乘方運算子
增加乘方運算（power operate），運算子是**，如果其中有一個運算元是real型別的，返回值將是real型別。兩個運算元都是integer型別，返回才是integer型別。
9、自動（可重入）任務和自動（遞迴）函式
（1）可重入任務
任務本質上是靜態的，同時併發執行的多個任務共享儲存區。當某個任務在模組中的多個地方被同時呼叫，則這兩個任務對同一塊地址空間進行操作，結果可能是錯誤的。verilog‐2001中增加了關鍵字automatic，記憶體空間是動態分配的，使任務成為可重入的。
（2）遞迴函式
10、自動寬度擴充套件
verilog‐1995中對於不指定位數的位寬超過32為的匯流排賦高阻時，只會對低32位賦值為高阻，高位將為0。
verilog‐2001將高阻或不定態賦值給未指定位寬的訊號時，可以自動擴充套件到整個位寬範圍。
11、常數函式
verilog語法規定必須使用數值或常數表示式來定義向量的位寬和陣列的規模。
verilog‐1995中要求上述表示式必須為算數操作。
verilog‐2001中可以使用函式，成為常數函式。他的數值在編譯或詳細描述中被確定。
12、增加了檔案輸入輸出操作
verilog‐1995中在檔案的輸入/輸出操作方面功能非常有限，檔案操作經常藉助於verilog pli（程式語言介面），通過與c語言的檔案輸入/輸出庫的訪問來處理。並且規定同時開啟的i/o檔案數不能多於31個。
verilog‐2001增加了新的系統任務和函式，並且規定同時開啟的檔案數目為230個
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